參數(shù)資料
型號(hào): μPD78042F
廠商: NEC Corp.
英文描述: 8 Bit Single Chip Microcontrollers(8位單片微控制器)
中文描述: 8位單片機(jī)微控制器(8位單片微控制器)
文件頁(yè)數(shù): 76/194頁(yè)
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代理商: ΜPD78042F
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57
CHAPTER 4 INSTRUCTION SET
16-Bit
ADDW
AX,#word
3
6
AX,CY
AX+word
×
×
×
Operation
SUBW
AX,#word
3
6
AX,CY
AX–word
×
×
×
CMPW
AX,#word
3
6
AX–word
×
×
×
Multiply/
MULU
X
2
16
AX
A
×
X
divide
DIVUW
C
2
25
AX (quotient), C (remainder)
AX
÷
C
Increment/
INC
r
1
2
r
r+1
×
×
decrement
saddr
2
4
6
(saddr)
(saddr)+1
×
×
DEC
r
1
2
r
r–1
×
×
saddr
2
4
6
(saddr)
(saddr)–1
×
×
INCW
rp
1
4
rp
rp+1
DECW
rp
1
4
rp
rp–1
Rotate
ROR
A,1
1
2
(CY,A
7
A
0
, A
m–1
A
m
)
×
1
×
ROL
A,1
1
2
(CY,A
0
A
7
, A
m+1
A
m
)
×
1
×
RORC
A,1
1
2
(CY
A
0
, A
7
CY, A
m–1
A
m
)
×
1
×
ROLC
A,1
1
2
(CY
A
7
, A
0
CY, A
m+1
A
m
)
×
1
×
ROR4
[HL]
2
10
12
A
3–0
(HL)
3–0
, (HL)
7–4
A
3–0
,
(HL)
3–0
(HL)
7–4
ROL4
[HL]
2
10
12
A
3–0
(HL)
7–4
, (HL)
3–0
A
3–0
,
(HL)
7–4
(HL)
3–0
BCD Adjust
ADJBA
2
4
Decimal Adjust Accumulator after Addition
×
×
×
ADJBS
2
4
Decimal Adjust Accumulator after Subtract
×
×
×
Bit
MOV1
CY,saddr.bit
3
6
7
CY
(saddr.bit)
×
Manipulation
CY,sfr.bit
3
7
CY
sfr.bit
×
CY,A.bit
2
4
CY
A.bit
×
CY,PSW.bit
3
7
CY
PSW.bit
×
CY,[HL].bit
2
6
7
CY
(HL).bit
×
saddr.bit,CY
3
6
8
(saddr.bit)
CY
sfr.bit,CY
3
8
sfr.bit
CY
A.bit,CY
2
4
A.bit
CY
PSW.bit,CY
3
8
PSW.bit
CY
×
×
[HL].bit,CY
2
6
8
(HL).bit
CY
Notes 1.
When the internal high-speed RAM area is accessed or in the instruction with no data access.
When an area except the internal high-speed RAM area is accessed.
2.
Remark
1 instruction clock cycle is 1 CPU clock cycle (f
CPU
) selected by the processor clock control register
(PCC).
Instruction
Group
Clock
Flag
Mnemonic
Operands
Byte
Operation
Note 1
Note 2
Z AC CY
相關(guān)PDF資料
PDF描述
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