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參數(shù)資料
| 型號(hào)： | XQV300-4BGG352N |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1536 CLBS, 322970 GATES, PBGA352 |
| 封裝： | PLASTIC, BGA-352 |
| 文件頁(yè)數(shù)： | 30/31頁(yè) |
| 文件大?。?/td> | 253K |
| 代理商： | XQV300-4BGG352N |
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QPro Virtex 2.5V QML High-Reliability FPGAs
8
DS002 (v1.5) December 5, 2001
1-800-255-7778
Preliminary Product Specification
R
IOB Output Switching Characteristics Standard Adjustments
Output delays terminating at a pad are specified for LVTTL with 12 mA drive and fast slew rate. For other standards, adjust
the delays by the values shown.
Symbol
Description
Standard
Speed Grade
Units
-4
Output Delay Adjustments
TOLVTTL_S2
Standard-specific adjustments for output delays
terminating at pads (based on standard capacitive
load, Csl)
LVTTL, slow
2 mA
17.0
ns
TOLVTTL_S4
4 mA
8.6
ns
TOLVTTL_S6
6 mA
5.6
ns
TOLVTTL_S8
8 mA
3.5
ns
TOLVTTL_S12
12 mA
2.2
ns
TOLVTTL_S16
16 mA
2.0
ns
TOLVTTL_S24
24 mA
1.6
ns
TOLVTTL_F2
LVTTL, fast
2 mA
15.1
ns
TOLVTTL_F4
4 mA
6.1
ns
TOLVTTL_F6
6 mA
3.6
ns
TOLVTTL_F8
8 mA
1.2
ns
TOLVTTL_F12
12 mA
0.0
ns
TOLVTTL_F16
16 mA
–0.05
ns
TOLVTTL_F24
24 mA
–0.23
ns
TOLVCMOS2
LVCMOS2
0.12
ns
TOPCI33_3
PCI, 33 MHz, 3.3V
2.7
ns
TOPCI33_5
PCI, 33 MHz, 5.0V
3.3
ns
TOGTL
GTL
0.6
ns
TOGTLP
GTL+
1.0
ns
TOHSTL_I
HSTL I
–0.5
ns
TOHSTL_III
HSTL III
–1.0
ns
TOHSTL_IV
HSTL IV
–1.1
ns
TOSSTL2_I
SSTL2 I
–0.5
ns
TOSSTL2_II
SSTL2 II
–1.0
ns
TOSSTL3_I
SSTL3 I
–0.5
ns
TOSSTL3_II
SSTL3 II
–1.1
ns
TOCTT
CTT
–0.6
ns
TOAGP
AGP
–1.0
ns
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