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參數(shù)資料
| 型號(hào)： | STLC5460 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Line Card Interface Controller(線路卡片接口控制器) |
| 中文描述： | 線卡接口控制器（線路卡片接口控制器） |
| 文件頁(yè)數(shù)： | 4/54頁(yè) |
| 文件大?。?/td> | 376K |
| 代理商： | STLC5460 |
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PIN DEFINITIONSAND FUNCTIONS
(continued)
Symbol
AS/ALE
Pin n PLCC
31
Type
I
Function
Multiplexed A/D mode:
used to latch the address from ADn
Non Multiplexed A/D Mode:
This pin at VSS indicates Intel like interfaces
This pin at VDD indicates Motorola like interfaces.
Interrupt line, active low.
Data clock output.
Frame synchronization output.
Power supply : 5V
Ground.
GCI Data input 1
GCI Data input 0
Non Multiplexed Mode:
this input interfaces to the system’s address bus to select an internal
register for a read or write access.
Multiplexed Mode:
A3 at VDD, DS/NRD signal provided by the system is not inverted by the
circuit
A3 at VSS, DS/NRD signal provided by the system isinverted by the circuit
GCI Data Output 0
GCI Data Output 1
P0 at VSS: variable access mode
P0 at VDD: fixed access mode
If P0 at VSS:
Intel like mode: this pin delivers NRDY
Motorola mode: this pin deliversNWAIT
Reset. A logical high on this input forces the STLC5460 into the reset state
INT
DCL
FSC
VDD2
VSS2
DIN1
DIN0
A3
32
33
34
35
36
37
38
39
OD
0
O
I
I
I
I
I (**)
DOUT0
DOUT1
PO
40
41
42
O
O
I (**)
NRDY/N
WAIT
43
OD
RES
44
I
(*): (I) Input
(O) Output
(IO) In/Output
(OD) Open Drain
(**): With Pull up resistance.
DCL
FSC
DOUT0
DIN0
DOUT1
DIN1
MUX0/GCI0
MUX1/GCI1
LCIC
PCM3
PCM0
PCM1
PCM2
PDC
PFS
RxD3
TxD3
TSC3
RxD0
TxD0
TSC0
RxD1
TxD1
TSC1
RxD2
TxD2
TSC2
MICROPROCESSOR INTERFACE
D94TL159A
CLOCKS
Figure 1:
GCI and PCM Interfaces.
STLC5460
4/54
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| STLC7550 | LOW POWER LOW VOLTAGE ANALOG FRONT END |
| STLC8100 | DUAL BAND WIRELESS LAN RF TRANSCEIVER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| STLC5465 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MULTI - HDLC WITH N X 64 SWITCHING MATRIX ASSOCIATED |
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