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參數(shù)資料
| 型號： | STLC5460 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Line Card Interface Controller(線路卡片接口控制器) |
| 中文描述： | 線卡接口控制器（線路卡片接口控制器） |
| 文件頁數(shù)： | 31/54頁 |
| 文件大?。?/td> | 376K |
| 代理商： | STLC5460 |
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connectedinstead of Insert A Register if DCG = 0, and insteadof Insert A and
Insert B Registersif DCG = 1.
WhenSGV goes to ”1”, the currentcontents of Command Register (CMD) is taken
into account by the generator.In this case, Command Registermeans :
7
0
0
0
BCH1
BCH0
0
0
ACH1
ACH0
BCH1/0
Insert B channel 1/0.
If generatortransmits sequenceinstead of Insert B register, the data
rate for this channel is given by BCH1/0
BCH1
0
0
1
1
BCH0
0
1
0
1
8 kb/s
16 kb/s
32 kb/s
64 kb/s
ACH1/0
Insert A channel 1/0
If generatortransmits sequenceinstead of insertA Register, the data rate for this
channel is givenby ACH1/0.
ACH1
0
0
1
1
ACH0
0
1
0
1
8 kb/s
16 kb/s
32 kb/s
64 kb/s
If DCG = 1, the datarate of PRSgenerator is the sum of datarate Insert B
channel and Insert A channel.
If DCG = 0, the datarate of PRSgenerator is equal to data rate of InsertA channel.
ERROR COUNTER REGISTER (ECR)
7
0
EC7
EC6
EC5
EC4
EC3
EC2
EC1
EC0
After RESET 00 (H).
If the Pseudo Random Sequence Analyser is validated (SAV = 1), this register indicates the number of
errored bits received after the synchronisation of the Pseudo Random Sequence. When Error Counter
Register indicates all ”1”s, the synchronisationis lost. After reading by the microprocessor, ECR is put to
”0”.
STLC5460
31/54
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PDF描述 |
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參數(shù)描述 |
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