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參數資料
| 型號： | STLC5460 |
| 廠商： | 意法半導體 |
| 英文描述： | Line Card Interface Controller(線路卡片接口控制器) |
| 中文描述： | 線卡接口控制器（線路卡片接口控制器） |
| 文件頁數： | 16/54頁 |
| 文件大?。?/td> | 376K |
| 代理商： | STLC5460 |
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INPUT PCM OFFSETREGISTER (IPOF)
7
0
IOF9
IOF8
IOF7
IOF6
After Reset 00 (H)
IOF5
IOF4
IOF3
IOF2
IOF9/2
InputPCM Offset 9 to 2.
Associated with IOF1/0, these ten bits indicate the delay between PFS signal and the
first bit of the frame,for each input
OUTPUT PCM OFFSET REGISTER (OPOF)
7
0
OOF9
OOF8
OOF7
OOF6
After Reset 00 (H)
IOF5
OOF4
OOF3
OOF2
OOF9/2
Output PCM Offset 9 to 2.
Associated with OOF1/0 of complementary offset register, these ten bits indicate the
delay betweenbit 0 of theframe out going versusbit 0 of the frame incoming.
INPUT PCM SHIFT 1 (IPSH1)
7
0
0
P1SH2
P1SH1
P1SH0
After Reset 00 (H)
0
P0SH2
P0SH1
P0SH0
P1SH2/0
PCM1 Shift 2 to 0.
This number (0 to 7) is added to Input PCM offset to obtain the total shift of the frame of
PCM1.
P0SH2/0
PCM0 shift2 to 0.
This number (0 to 7) is added to Input PCM offset to obtain the total shift of the frame of
PCM0.
INPUT PCM SHIFT 2 (IPSH2)
7
0
0
P3SH2
P3SH1
P3SH0
After Reset 00 (H)
0
P2SH2
P2SH1
P2SH0
P3SH2/0
PCM3 Shift 2 to 0.
This number (0 to 7) is added to Input PCM offset to obtain the total shift of the frame of
PCM3.
P2SH2/0
PCM2 Shift 2 to 0.
This number (0 to 7) is added to Input PCM offset to obtain the total shift of the frame of
PCM2.
OUTPUT PCM SHIFT 1 (OPSH1)
7
0
P1E
P1SH2
P1SH1
P1SH0
After Reset 00 (H)
P0E
P0SH2
P0SH1
P0SH0
P1E
Output PCM1 Enable.
P1E = 0. PCM1 output is at high impedance.
P1E = 1. PCM1 output is enable.
STLC5460
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