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    • 參數(shù)資料
      型號(hào): SII3114CT176
      元件分類(lèi): 總線控制器
      英文描述: PCI BUS CONTROLLER, PQFP176
      封裝: TQFP-176
      文件頁(yè)數(shù): 67/127頁(yè)
      文件大小: 564K
      代理商: SII3114CT176
      第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)當(dāng)前第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)
      SiI3114 PCI to Serial ATA Controller
      Data Sheet
      Silicon Image, Inc.
      SiI-DS-0103-D
      36
      2007 Silicon Image, Inc.
      Data Transfer Mode – Channel 0/2
      Address Offset: 80H
      Access Type: Read/Write
      Reset Value: 0x0000_0022
      31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
      Reserved
      R
      e
      served
      D
      evice
      1
      Transfer
      Mode
      R
      e
      served
      D
      evice
      0
      Transfer
      Mode
      This register defines the transfer mode register for Channel 0/2 in the SiI3114. The register bits are also mapped
      to Base Address 5, Offset B4H. See “Data Transfer Mode – Channel X” section on page 66 for bit definitions.
      Data Transfer Mode – Channel 1/3
      Address Offset: 84H
      Access Type: Read/Write
      Reset Value: 0x0000_0022
      31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
      Reserved
      R
      e
      served
      D
      e
      vice
      1
      Transf
      er
      M
      ode
      R
      e
      served
      D
      e
      vice
      0
      Transf
      er
      M
      ode
      This register defines the transfer mode register for Channel 1/3 in the SiI3114. The register bits are also mapped
      to Base Address 5, Offset F4H. See “Data Transfer Mode – Channel X” section on page 66 for bit definitions.
      System Configuration Status – Command
      Address Offset: 88H
      Access Type: Read/Write
      Reset Value: 0x0000_0000
      31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
      Reserved
      C
      hnl3
      Int
      B
      lock
      C
      hnl2
      Int
      B
      lock
      C
      hnl1
      Int
      B
      lock
      C
      hnl0
      Int
      B
      lock
      Reserved
      M
      66EN
      Reserved
      Chnl2
      Module
      Rst
      Chnl3
      Module
      Rst
      FF2
      Module
      Rst
      FF3
      Module
      Rst
      Chnl0
      Module
      Rst
      Chnl1
      Module
      Rst
      FF0
      Module
      Rst
      FF1
      Module
      Rst
      R
      eserved
      ARB
      Module
      Rs
      t
      PBM
      Module
      Rst
      This register defines the system configuration status and command register for the SiI3114. The register bits are
      also mapped to Base Address 5, Offset 48H. See “System Configuration Status – Command” section on page 57
      for bit definitions.
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