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參數(shù)資料
| 型號： | SAA7715H |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Digital Signal Processor |
| 中文描述： | 24.576 MHz, OTHER DSP, PQFP44 |
| 封裝： | 10 X 10 X 1.75 MM, PLASTIC, QFP-44 |
| 文件頁數(shù)： | 29/36頁 |
| 文件大?。?/td> | 180K |
| 代理商： | SAA7715H |
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2001 May 07
29
Philips Semiconductors
Preliminary specification
Digital Signal Processor
SAA7715H
15 I
2
C-BUS TIMING
handbook, full pagewidth
MSC610
S
Sr
tSU;STO
tSU;STA
tHD;STA
tHIGH
tLOW
tSU;DAT
tHD;DAT
tf
SDA
SCL
P
S
tBUF
tr
tf
tr
tSP
tHD;STA
Fig.10 Definition of timing on the I
2
C-bus.
Table 20
Timing of I
2
C-bus (see Fig.10)
SYMBOL
PARAMETER
CONDITIONS
STANDARDMODE
I
2
C-BUS
FAST MODE I
2
C-BUS
UNIT
MIN.
MAX.
MIN.
MAX.
f
SCL
t
BUF
SCL clock frequency
bus free time between a
STOP and START
condition
hold time (repeated)
START condition; after this
period, the first clock pulse
is generated
SCL LOW period
SCL HIGH period
set-up time for a repeated
START condition
DATA hold time
DATA set-up time
rise time of both SDA and
SCL signals
fall time of both SDA and
SCL signals
set-up time for STOP
condition
capacitive load for each
bus line
pulse width of spikes to be
suppressed by input filter
0
4.7
100
0
1.3
400
kHz
μ
s
t
HD;STA
4.0
0.6
μ
s
t
LOW
t
HIGH
t
SU;STA
4.7
4.0
4.7
1.3
0.6
0.6
μ
s
μ
s
μ
s
t
HD;DAT
t
SU;DAT
t
r
0
250
1000
0
100
20 + 0.1C
b
300
0.9
μ
s
ns
ns
C
b
in pF
t
f
C
b
in pF
300
20 + 0.1C
b
300
ns
t
SU;STO
4.0
0.6
μ
s
C
b
400
400
pF
t
SP
not applicable
0
50
ns
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PDF描述 |
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