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參數(shù)資料
| 型號： | SAA7381 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | ATAPI CD-R block decoder |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| 文件頁數(shù)： | 70/108頁 |
| 文件大?。?/td> | 380K |
| 代理商： | SAA7381 |
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1997 Aug 12
70
Philips Semiconductors
Objective specification
ATAPI CD-R block decoder
SAA7381
11 TIMING CHARACTERISTICS
11.1
External memory interface timing
Table 104
DRAM interface timing (fast-page mode); see Figs 13 and 14 and note 1
Note
1.
For further information regarding the DRAM timing please consult the device user manual or contact product support.
SYMBOL
PARAMETER
MIN.
MAX.
UNIT
T
cy
t
ACC(CAS)
t
ACC(RAS)
t
RASH
t
RASL
t
h(RAS)
t
CASL
t
h(CAS)
t
d(CASH-RAS)
t
d(RAS-CAS)
t
d(RAS-CA)
t
su(RA)
t
h(RA)
t
su(CA)
t
h(CA)
t
h(CA-RASL)
t
l(CA-RAS)
t
h(R)
t
h(R-RAS)
t
su(W)
t
h(W)
t
WL
t
h(W-RAS)
t
l(W-CAS)
t
l(W-RAS)
t
su(DO)
t
h(DO)
t
h(DO-RAS)
read or write cycle period
access time from CAS
access time from RAS
RAS HIGH time
RAS LOW time
RAS hold time
CAS LOW time
CAS hold time
delay time CAS HIGH to RAS
RAS to CAS delay time
RAS to column address delay time
row address set-up time
row address hold time
column address set-up time
column address hold time
column address hold time from RAS LOW
column address to RAS lead time
read command hold time
read command hold time from RAS
write command set-up time
write command hold time
write command LOW time
write command hold time from RAS
write command to CAS lead time
write command to RAS lead time
data output set-up time
data output hold time
data output hold time from RAS
160
70
80
20
20
80
10
25
20
0
15
0
20
60
40
0
60
0
15
15
60
20
20
0
15
60
20
10000
10000
ns
ns
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