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參數(shù)資料
| 型號： | SAA7381 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | ATAPI CD-R block decoder |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| 文件頁數(shù)： | 62/108頁 |
| 文件大?。?/td> | 380K |
| 代理商： | SAA7381 |
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1997 Aug 12
62
Philips Semiconductors
Objective specification
ATAPI CD-R block decoder
SAA7381
Table 94
Description of the UARTCOM register bits
Table 95
Description of the UARTSTAT register bits
Table 96
Description of the UARTAUXSTAT register bits
Table 97
CD playback error rate measurement registers
BIT
NAME
VALUE
DESCRIPTION
7
paron
0
1
0
1
0
1
disable parity bit in S2B mode
enable parity bit in S2B mode
S2B transmission mode
SPI transmission mode
SPI clock active LOW; S2B even parity
SPI clock active HIGH; S2B odd parity
6
spion
0
parpol clkpol
BIT
NAME
VALUE
DESCRIPTION
7
comsync
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
comsync pin level
6
syssync
syssync pin level
5
comsync
inverted comsync pin level
4
syssync
inverted syssync pin level
3
txbfull
transmit data buffer is empty and ready for another byte
receive data buffer is not valid
receive data buffer is valid
a byte was lost because the ‘rxdata’ register was not read in time
received parity bit is in error
2
rxbfull
1
overrun
0
rxparity
BIT
NAME
VALUE
DESCRIPTION
7
comiack
0
1
0
1
0
1
comiack pin level
6
txfull
transmit register is full (a byte is being sent)
receive register holds a byte, need to read a byte immediately to avoid
overrun
5
rxfull
ADDRESS
NAME
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
FF11H
FF12H
C1BLERCNT
C2BLERCNT
d7
d7
d6
d6
d5
d5
d4
d4
d3
d3
d2
d2
d1
d1
d0
d0
相關(guān)PDF資料 |
PDF描述 |
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