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參數(shù)資料
| 型號： | SAA7381 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | ATAPI CD-R block decoder |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| 文件頁數(shù)： | 41/108頁 |
| 文件大?。?/td> | 380K |
| 代理商： | SAA7381 |
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1997 Aug 12
41
Philips Semiconductors
Objective specification
ATAPI CD-R block decoder
SAA7381
Table 64
Description of the ‘trant’ bits
7.5.3.12
ADRSEL
This is the ATAPI drive select register.
Table 65
ADRSEL: address FF8CH
Note
1.
Bit 4 of this register is the ‘drv’ bit. When this bit is the same as the ‘rdrv’ bit in the DTCTR register then the SAA7381
will be the selected ATAPI drive and will respond to commands and produce interrupts. The host interrupt pin will
also be enabled when the SAA7381 is the selected drive.
7.5.3.13
AINTR
This is the ATAPI interrupt reason register. See the ATAPI specification for a detailed description of these register bits.
Table 66
AINTR: address FF8DH
7.5.3.14
AERR
This is the ATAPI error register. See the ATAPI specification for a detailed description of these register bits.
Table 67
AERR: address FF8EH
trant
(bits 2 to 0)
000
FROM
TO
MAXIMUM
BYTES
65535
(ATAPI, PIO)
65535
(ATAPI, PIO)
12
12
reserved
NOTES
host
maximum bytes for auto sequence DMA is
4.3 Gbytes
maximum bytes for auto sequence DMA is
4.3 Gbytes
redundant
redundant
PIO; DBC not used, always 12 bytes
DMA and PIO
001
host
memory
010
011
100
101
11X
microcontroller
memory
host
microcontroller
reserved
memory
microcontroller
microcontroller
host
reserved
ACCESS
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
RW
1
1
1
drv
(1)
ACCESS
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
RW
release
io
cod
ACCESS
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
RW
sense key
mcr
abrt
eom
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