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參數(shù)資料
| 型號(hào)： | SAA7374GP |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | Low voltage digital servo processor and Compact Disc decoder CD7LV |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP64 |
| 封裝： | 14 X 14 MM, 2.70 MM HEIGHT, PLASTIC, MS-022, SOT-393-1, QFP-64 |
| 文件頁數(shù)： | 48/60頁 |
| 文件大?。?/td> | 324K |
| 代理商： | SAA7374GP |
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1998 Feb 26
48
Philips Semiconductors
Product specification
Low voltage digital servo processor and
Compact Disc decoder (CD7LV)
SAA7374
10 OPERATING CHARACTERISTICS (SUBCODE INTERFACE TIMING)
V
DD
= 3.0 to 3.6 V; V
SS
= 0 V; T
amb
=
10 to +70
°
C; unless otherwise specified.
Note
1.
The subcode timing is directly related to the overspeed factor ‘n’ in normal operating mode. ‘n’ is replaced by the disc
speed factor ‘d’, in the lock-to-disc mode.
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
Subcode interface timing (single speed
×
n);
(see Fig.31)
;
note 1
I
NPUT
: RCK
t
H
t
L
t
r
t
f
t
dC
O
UTPUTS
: SBSY, SFSY
AND
SUB (C
L
= 20 pF)
t
Bcy
block cycle
t
BW
SBSY pulse width
t
Fcy
frame cycle
t
FW
SFSY pulse width (3-wire mode only)
t
FH
SFSY HIGH time
t
FL
SFSY LOW time
t
dPAC
delay time SFSY to SUB (P data)
valid
t
dAC
delay time RCK falling to SUB
t
hD
hold time RCK to SUB
input clock HIGH time
input clock LOW time
input clock rise time
input clock fall time
delay time SFSY to RCK
2/n
2/n
10/n
4/n
4/n
6/n
6/n
80/n
80/n
20/n
μ
s
μ
s
ns
ns
μ
s
12.0/n
122/n
13.3/n
136/n
14.7/n
300/n
150/n
366/n
66/n
84/n
1/n
ms
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
0
0.7/n
μ
s
μ
s
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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