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參數(shù)資料
| 型號： | SAA7151B |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 顏色信號轉(zhuǎn)換 |
| 英文描述： | Digital multistandard colour decoder with SCART interface DMSD2-SCART |
| 中文描述： | COLOR SIGNAL DECODER, PQCC68 |
| 封裝： | PLASTIC, MO-047AC, SOT-188-2, LCC-68 |
| 文件頁數(shù)： | 16/49頁 |
| 文件大?。?/td> | 311K |
| 代理商： | SAA7151B |
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April 1993
16
Philips Semiconductors
Product specification
Digital multistandard colour decoder with
SCART interface (DMSD2-SCART)
SAA7151B
Fig.10 Line control by HREF in 4:2:2 format for 50 Hz and 60 Hz systems.
handbook, full pagewidth
MEH297
start of
active line
Byte number for pixels:
Y signal
0
1
2
3
4
5
U0
V0
U2
V2
U4
V4
6
7
U6
V6
50/60 Hz
U and V signal
HREF
CREF
handbook, full pagewidth
MEH298
CREF
HREF
end of
active line
Byte number for pixels:
Y signal
714
715
716
717
718
719
U714
V714
U716
V716
U718
V718
50/60 Hz
U and V signal
Fig.11 RTCO timing.
handbook, full pagewidth
MEH341
RTCO
(1)
Sequence bit:
SECAM: 0 equals DB-line
1 equals DR-line
PAL:
0 equals (R-Y) line normal
1 equals (R-Y) line inverted
NTSC:
0 (no change)
(2)
Reserve bits: 236 for 50 Hz systems; 233 for 60 Hz systems
128 clocks
HPLL
increment
bits 13 to 0
FSCPLL
increment
bits 21 to 0
10
H/L transition
(counter start)
valid
0
4
8
14
19
15
21
13
0
20
5
sequence bit
(1)
reserved
(2)
61
67
1 0
bit
time slot
(LL27/4)
4 bits
reserve
5 bits
reserve
not valid
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAA7157 | Clock signal generator circuit for digital TV systems SCGC |
| SAA7157T | Clock signal generator circuit for digital TV systems SCGC |
| SAA7158 | Back END IC |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| SAA7154H/V2,557 | 制造商:NXP Semiconductors 功能描述: |
| SAA7157 | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Clock signal generator circuit for digital TV systems SCGC |
| SAA7157T | 制造商:NXP Semiconductors 功能描述: |
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