參數(shù)資料
型號： PIC24FV32KA301-I/P
廠商： Microchip Technology
文件頁數(shù)： 323/352頁
文件大?。?/td> 0K
描述： MCU 32KB FLASH 2KB RAM 20-PDIP
標(biāo)準(zhǔn)包裝： 22
系列： PIC® XLP™ 24F
核心處理器： PIC
芯體尺寸： 16-位
速度： 32MHz
連通性： I²C，IrDA，LIN，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，HLVD，POR，PWM，WDT
輸入/輸出數(shù)： 17
程序存儲器容量： 32KB（11K x 24）
程序存儲器類型： 閃存
EEPROM 大小： 512 x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
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PIC24FV32KA304 FAMILY
DS39995C-page 72
2011-2012 Microchip Technology Inc.
7.1
Clock Source Selection at Reset
If clock switching is enabled, the system clock source at
device Reset is chosen, as shown in Table 7-2. If clock
switching is disabled, the system clock source is always
selected according to the Oscillator Configuration bits.
For more information, see Section 9.0 “Oscillator
TABLE 7-2:
OSCILLATOR SELECTION vs.
TYPE OF RESET (CLOCK
SWITCHING ENABLED)
7.2
Device Reset Times
The Reset times for various types of device Reset are
summarized in Table 7-3. Note that the system Reset
signal, SYSRST, is released after the POR and PWRT
delay times expire.
The time at which the device actually begins to execute
code will also depend on the system oscillator delays,
which include the Oscillator Start-up Timer (OST) and
the PLL lock time. The OST and PLL lock times occur
in parallel with the applicable SYSRST delay times.
The FSCM delay determines the time at which the
FSCM begins to monitor the system clock source after
the SYSRST signal is released.
TABLE 7-3:
RESET DELAY TIMES FOR VARIOUS DEVICE RESETS
Reset Type
Clock Source Determinant
POR
FNOSCx Configuration bits
(FNOSC<10:8>)
BOR
MCLR
COSCx Control bits
(OSCCON<14:12>)
WDTO
SWR
Reset Type
Clock Source
SYSRST Delay
System Clock
Delay
Notes
POR(6)
EC
TPOR + TPWRT
—
1, 2
FRC, FRCDIV
TPOR + TPWRT
TFRC
1, 2, 3
LPRC
TPOR + TPWRT
TLPRC
1, 2, 3
ECPLL
TPOR + TPWRT
TLOCK
1, 2, 4
FRCPLL
TPOR + TPWRT
TFRC + TLOCK 1, 2, 3, 4
XT, HS, SOSC
TPOR+ TPWRT
TOST
1, 2, 5
XTPLL, HSPLL
TPOR + TPWRT
TOST + TLOCK
1, 2, 4, 5
BOR
EC
TPWRT
—
FRC, FRCDIV
TPWRT
TFRC
2, 3
LPRC
TPWRT
TLPRC
2, 3
ECPLL
TPWRT
TLOCK
2, 4
FRCPLL
TPWRT
TFRC + TLOCK 2, 3, 4
XT, HS, SOSC
TPWRT
TOST
2, 5
XTPLL, HSPLL
TPWRT
TFRC + TLOCK 2, 3, 4
All Others
Any Clock
—
None
Note 1:
TPOR = Power-on Reset delay.
2:
TPWRT = 64 ms nominal if the Power-up Timer is enabled; otherwise, it is zero.
3:
TFRC and TLPRC = RC Oscillator start-up times.
4:
TLOCK = PLL lock time.
5:
TOST = Oscillator Start-up Timer (OST). A 10-bit counter waits 1024 oscillator periods before releasing the
oscillator clock to the system.
6:
If Two-Speed Start-up is enabled, regardless of the primary oscillator selected, the device starts with
FRC, and in such cases, FRC start-up time is valid.
Note:
For detailed operating frequency and timing specifications, see Section 29.0 “Electrical Characteristics”.
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