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參數(shù)資料
| 型號(hào)： | Q67101-H6789 |
| 廠商： | SIEMENS AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 245/272頁 |
| 文件大小： | 4055K |
| 代理商： | Q67101-H6789 |
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SAB 82532/SAF 82532
Electrical Characteristics
Semiconductor Group
245
07.96
Figure 57
Siemens/Intel Write Cycle Timing
Note 1: Function of DTACK is described logically as:
DTACK = (CS
×
DACKA
×
DACKB + RD
×
WR )
×
INTAi.
INTAi is an internally generated signal.
Note 2: DRT is reset with the falling edge of CS or DACK if the last write access to XFIFO
is expected. However, DRT will be activated again in the case of an access to
any other register or FIFO.
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