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參數(shù)資料
| 型號： | PSOC |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | 8-Bit Programmable System-on-Chip (PSoC⑩) Microcontrollers |
| 中文描述： | 8位可編程系統(tǒng)（的PSoC⑩）微控制器片上 |
| 文件頁數(shù)： | 82/148頁 |
| 文件大?。?/td> | 1412K |
| 代理商： | PSOC |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁當(dāng)前第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁
Cypress MicroSystems CY8C25122/CY8C26233/CY8C26443/CY8C26643 Family Data Sheet
82
Document #: 38-12010 CY Rev. ** CMS Rev. 3.20
September 5, 2002
10.8.2.3
Analog Continuous Time Type A Block xx Control 2 Register
CPhase controls which internal clock phase the compar-
ator data is latched on.
CLatch controls whether the latch is active or if it is
always transparent.
CompCap controls whether the compensation capacitor
is switched in or not in the op-amp. By not switching in
the compensation capacitance, a much faster response
can be obtained if the amplifier is being used as a com-
parator.
TestMux – selects block bypass mode for testing and
characterization purposes.
Power – encoding for selecting 1 of 4 power levels. The
blocks always power up in the off state.
Analog Continuous Time Block 00 Control 2 Register (ACA00CR2, Address = Bank 0/1, 73h)
Analog Continuous Time Block 01 Control 2 Register (ACA01CR2, Address = Bank 0/1, 77h)
Analog Continuous Time Block 02 Control 2 Register (ACA02CR2, Address = Bank 0/1, 7Bh)
Analog Continuous Time Block 03 Control 2 Register (ACA03CR2, Address = Bank 0/1, 7Fh)
Table 67:
Analog Continuous Time Type A Block xx Control 2 Register
Bit #
POR
Read/
Write
Bit Name
7
6
5
4
3
2
1
0
0
0
0
0
0
0
0
0
RW
RW
RW
RW
RW
RW
RW
RW
CPhase
CLatch
CompCap
TestMux[2]
TestMux[1]
TestMux[0]
Power[1]
Power[0]
Bit 7
:
CPhase
0 = Comparator Control latch transparent on PHI1
1 = Comparator Control latch transparent on PHI2
Bit 6
:
CLatch
0 = Comparator Control latch is always transparent
1 = Comparator Control latch is active
Bit 5
:
CompCap
0 = Comparator Mode
1 = Op-amp Mode
Bit [4:2]
:
TestMux [2:0]
Select block bypass mode for testing and characterization purposes
ACA00
ACA01
1 0 0 = Positive Input to…ABUS0
ABUS1
1 0 1 = AGND to…
ABUS0
ABUS1
1 1 0 = REFLO to…
ABUS0
ABUS1
1 1 1 = REFHI to…
ABUS0
ABUS1
0 x x = All Paths Off
ACA02
ABUS2
ABUS2
ABUS2
ABUS2
ACA03
ABUS3
ABUS3
ABUS3
ABUS3
Bit [1:0]
:
Power [1:0]
Encoding for selecting 1 of 4 power levels
0 0 = Off
0 1 = Low (60 μA)
1 0 = Med (150 μA)
1 1 = High (500 μA)
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PDF描述 |
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參數(shù)描述 |
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