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參數(shù)資料
| 型號(hào)： | PIC24HJ256GP210T-I/PF |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 76/292頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PIC MCU FLASH 128KX16 100TQFP |
| 產(chǎn)品培訓(xùn)模塊： | Graphics LCD System and PIC24 Interface Asynchronous Stimulus |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | PIC® 24H |
| 核心處理器： | PIC |
| 芯體尺寸： | 16-位 |
| 速度： | 40 MIP |
| 連通性： | I²C，IrDA，LIN，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，DMA，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 85 |
| 程序存儲(chǔ)器容量： | 256KB（85.5K x 24） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 16K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 32x10b，32x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 包裝： | 帶卷 (TR) |
| 配用： | DM300024-ND - KIT DEMO DSPICDEM 1.1 MA240012-ND - MODULE PLUG-IN PIC24H 100QFP DV164033-ND - KIT START EXPLORER 16 MPLAB ICD2 DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32 AC164323-ND - MODULE SKT FOR 100TQFP |
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2009 Microchip Technology Inc.
DS70175H-page 165
PIC24HJXXXGPX06/X08/X10
REGISTER 17-2:
I2CxSTAT: I2Cx STATUS REGISTER
R-0 HSC
U-0
R/C-0 HS
R-0 HSC
ACKSTAT
TRSTAT
—
BCL
GCSTAT
ADD10
bit 15
bit 8
R/C-0 HS
R-0 HSC
R/C-0 HSC
R-0 HSC
IWCOL
I2COV
D_A
P
S
R_W
RBF
TBF
bit 7
bit 0
Legend:
U = Unimplemented bit, read as ‘0’
C = Clear only bit
R = Readable bit
W = Writable bit
HS = Set in hardware
HSC = Hardware set/cleared
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15
ACKSTAT: Acknowledge Status bit
(when operating as I2C master, applicable to master transmit operation)
1
= NACK received from slave
0
= ACK received from slave
Hardware set or clear at end of slave Acknowledge.
bit 14
TRSTAT: Transmit Status bit (when operating as I2C master, applicable to master transmit operation)
1
= Master transmit is in progress (8 bits + ACK)
0
= Master transmit is not in progress
Hardware set at beginning of master transmission. Hardware clear at end of slave Acknowledge.
bit 13-11
Unimplemented: Read as ‘0’
bit 10
BCL: Master Bus Collision Detect bit
1
= A bus collision has been detected during a master operation
0
= No collision
Hardware set at detection of bus collision.
bit 9
GCSTAT: General Call Status bit
1
= General call address was received
0
= General call address was not received
Hardware set when address matches general call address. Hardware clear at Stop detection.
bit 8
ADD10: 10-Bit Address Status bit
1
= 10-bit address was matched
0
= 10-bit address was not matched
Hardware set at match of 2nd byte of matched 10-bit address. Hardware clear at Stop detection.
bit 7
IWCOL: Write Collision Detect bit
1
= An attempt to write the I2CxTRN register failed because the I2C module is busy
0
= No collision
Hardware set at occurrence of write to I2CxTRN while busy (cleared by software).
bit 6
I2COV: Receive Overflow Flag bit
1
= A byte was received while the I2CxRCV register is still holding the previous byte
0
= No overflow
Hardware set at attempt to transfer I2CxRSR to I2CxRCV (cleared by software).
bit 5
D_A: Data/Address bit (when operating as I2C slave)
1
= Indicates that the last byte received was data
0
= Indicates that the last byte received was device address
Hardware clear at device address match. Hardware set by reception of slave byte.
bit 4
P: Stop bit
1
= Indicates that a Stop bit has been detected last
0
= Stop bit was not detected last
Hardware set or clear when Start, Repeated Start or Stop detected.
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PDF描述 |
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參數(shù)描述 |
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