參數(shù)資料
型號： PIC18F46J50-I/PT
廠商： Microchip Technology
文件頁數(shù)： 47/164頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 64KB 44-TQFP
產品培訓模塊： XLP Deep Sleep Mode
PIC18 J Series MCU Overview
PIC18F MPLAB® Starter Kit
8-bit PIC® Microcontroller Portfolio
標準包裝： 160
系列： PIC® XLP™ 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 48MHz
連通性： I²C，SPI，UART/USART，USB
外圍設備： 欠壓檢測/復位，DMA，POR，PWM，WDT
輸入/輸出數(shù)： 34
程序存儲器容量： 64KB（32K x 16）
程序存儲器類型： 閃存
RAM 容量： 3.8K x 8
電壓 - 電源 (Vcc/Vdd)： 2.15 V ~ 3.6 V
數(shù)據(jù)轉換器： A/D 13x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-TQFP
包裝： 托盤
產品目錄頁面： 657 (CN2011-ZH PDF)
配用： AC164330-ND - MODULE SKT FOR 44TQFP 18F45J10
PIC18F46J50 FAMILY
DS39931D-page 140
2011 Microchip Technology Inc.
TABLE 10-5:
PORTB I/O SUMMARY
Pin
Function
TRIS
Setting
I/O
Type
Description
RB0/AN12/
INT0/RP3
RB0
1
I
TTL
PORTB<0> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<0> data output; not affected by analog input.
AN12
1
I
ANA
A/D Input Channel 12.(1)
INT0
1
I
ST
External Interrupt 0 input.
RP3
1
I
ST
Remappable Peripheral Pin 3 input.
0
O
DIG
Remappable Peripheral Pin 3 output.
RB1/AN10/
PMBE/RTCC/
RP4
RB1
1
I
TTL
PORTB<1> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<1> data output; not affected by analog input.
AN10
1
I
ANA
A/D Input Channel 10.(1)
PMBE(3)
0
O
DIG
Parallel Master Port byte enable output.
RTCC
0
O
DIG
Real-Time Clock Calender output.
RP4
1
I
ST
Remappable Peripheral Pin 4 input.
0
O
DIG
Remappable Peripheral Pin 4 output.
RB2/AN8/
CTED1/PMA3/
VMO/REFO/
RP5
RB2
1
I
TTL
PORTB<2> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<2> data output; not affected by analog input.
AN8
1
I
ANA
A/D Input Channel 8.(1)
CTED1
1
I
ST
CTMU Edge 1 input.
PMA3(3)
0
O
DIG
Parallel Master Port address.
VMO
0
O
DIG
External USB transceiver D – data output.
REFO
0
O
DIG
Reference output clock.
RP5
1
I
ST
Remappable Peripheral Pin 5 input.
0
O
DIG
Remappable Peripheral Pin 5 output.
RB3/AN9/
CTED2/PMA2/
VPO/RP6
RB3
0
O
DIG
LATB<3> data output; not affected by analog input.
1
I
TTL
PORTB<3> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
AN9
1
I
ANA
A/D Input Channel 9.(1)
CTED2
1
I
ST
CTMU Edge 2 input.
PMA2(3)
0
O
DIG
Parallel Master Port address.
VPO
0
I
DIG
External USB transceiver D+ data output.
RP6
1
I
ST
Remappable Peripheral Pin 6 input.
0
O
DIG
Remappable Peripheral Pin 6 output.
Legend:
DIG = Digital level output; TTL = TTL input buffer; ST = Schmitt Trigger input buffer; ANA = Analog level
input/output; x = Don’t care (TRIS bit does not affect port direction or is overridden for this option)
Note 1:
Pins are configured as analog inputs by default on POR. Using these pins for digital inputs requires setting
the appropriate bits in the ANCONx register first.
2:
All other pin functions are disabled when ICSP or MPLAB ICD are enabled.
3:
This functionality is only available on 44-pin devices.
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