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參數(shù)資料
| 型號： | MCC5E0RX266WB0B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 266 MHz, RISC PROCESSOR, CBGA840 |
| 封裝： | 31 X 31 MM, 3.55 MM HEIGHT, 1 MM PITCH, CERAMIC, FCBGA-840 |
| 文件頁數(shù)： | 60/120頁 |
| 文件大小： | 1711K |
| 代理商： | MCC5E0RX266WB0B |
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44
CHAPTER 2: SIGNAL DESCRIPTIONS
C5ENPB0-DS REV 05
MOTOROLA GENERAL BUSINESS INFORMATION
PROM Interface Signals
The PROM interface is a low speed I/O port that allows the C-5e NP to communicate
through external logic to PROM. The PROM clock is 1/
2 to
1/
16 the core clock rate. The
maximum PROM size addressable is 4MBytes, and must use a “by 16” part. The PROM
signals are listed in Table 17.
Figure 5 shows the connections between the PROM Interface and external board logic.
The application is required to provide an external shift register with parallel-in and
parallel-out capabilities, and a parallel load register. Both devices should be
positive-edge-triggered and perform a parallel load whenever SPLD is asserted. When
SPLD is deasserted the shift register shifts.
Table 17 PROM Interface Signals
SIGNAL
NAME
PIN #
TOTAL
TYPE
I/O
SIGNAL DESCRIPTION
SPDO
Y1
1
LVTTL
O
Serial Data Out
SPDI
Y2
1
LVTTL
I
PD
Serial Data In
SPLD
Y3
1
LVTTL
O
When load is asserted on a positive clock
edge, the external logic performs a parallel
load. On each positive clock edge when
load is de-asserted, the shift registers shift.
When the PROM interface is idle:
If SPLD is asserted HI it indicates low
speed serial protocol,
If asserted LOW it indicates MDIO serial
protocol.
SPCK
Y4
1
LVTTL
O
Clock
TOTAL PINS
4
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MCF5206FT25 | 32-BIT, 25 MHz, RISC PROCESSOR, PQFP160 |
| MCF5206FT16 | 32-BIT, 16.67 MHz, RISC PROCESSOR, PQFP160 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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