參數(shù)資料
型號： MC9S12DJ128VFU
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： MC9S12DT128 Device User Guide V02.09
中文描述： 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP80
封裝： QFP-80
文件頁數(shù)： 114/124頁
文件大小： 2125K
代理商： MC9S12DJ128VFU
MC9S12DP512 Device Guide V01.23
114
Figure A-6 SPI Master Timing (CPHA=1)
In
Table A-19
the timing characteristics for master mode are listed.
Table A-19 SPI Master Mode Timing Characteristics
Num
Characteristic
Symbol
Unit
Min
1/2048
Typ
—
Max
1
/
2
2048
1
SCK Frequency
f
sck
t
sck
t
lead
t
lag
t
wsck
t
su
t
hi
t
vsck
t
vss
t
ho
t
rfi
t
rfo
f
bus
t
bus
t
sck
t
sck
t
sck
ns
1
SCK Period
2
—
2
Enable Lead Time
—
1/2
—
3
Enable Lag Time
—
1/2
—
4
Clock (SCK) High or Low Time
—
1/2
—
5
Data Setup Time (Inputs)
8
—
—
6
Data Hold Time (Inputs)
8
—
—
ns
9
Data Valid after SCK Edge
—
—
30
ns
10
Data Valid after SS fall (CPHA=0)
—
—
15
ns
11
Data Hold Time (Outputs)
20
—
—
ns
12
Rise and Fall Time Inputs
—
—
8
ns
13
Rise and Fall Time Outputs
—
—
8
ns
SCK
(OUTPUT)
SCK
(OUTPUT)
MISO
(INPUT)
MOSI
(OUTPUT)
1
5
6
MSB IN
2
BIT 6 . . . 1
LSB IN
MASTER MSB OUT
2
MASTER LSB OUT
BIT 6 . . . 1
4
4
9
12
13
11
PORT DATA
(CPOL
=
0)
(CPOL
=
1)
PORT DATA
SS
1
(OUTPUT)
2
12
13
3
1.If configured as output
2. LSBF = 0. For LSBF = 1, bit order is LSB, bit 1, ..., bit 6, MSB.
F
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n
.
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PDF描述
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