參數(shù)資料
型號(hào)： MC14562
廠商： Motorola, Inc.
英文描述： 128-Bit Static Shift Register
中文描述： 128位靜態(tài)移位寄存器
文件頁(yè)數(shù)： 3/6頁(yè)
文件大?。?/td> 183K
代理商： MC14562
MOTOROLA CMOS LOGIC DATA
3
MC14562B
Output Rise and Fall Time
tTLH, tTHL = (1.5 ns/pF) CL + 25 ns
tTLH, tTHL = (0.75 ns/pF) CL + 12.5 ns
tTLH, tTHL = (0.55 ns/pF) CL + 9.5 ns
Propagation Delay Time
Clock to Q
tPLH, tPHL = (1.7 ns/pF) CL + 515 ns
tPLH, tPHL = (0.66 ns/pF) CL + 217 ns
tPLH, tPHL = (0.5 ns/pF) CL + 145 ns
tTLH,
tTHL
5.0
10
15
—
—
—
100
50
40
200
100
80
ns
tPLH,
tPHL
5.0
10
15
—
—
—
600
250
170
1200
500
340
ns
Clock Pulse Width
(50% Duty Cycle)
tWH
5.0
10
15
600
220
150
300
110
75
—
—
—
ns
Clock Pulse Frequency
fcl
5.0
10
15
—
—
—
1.9
5.6
8.0
1.1
3.0
4.0
MHz
Data to Clock Setup Time
tsu(1)
5.0
10
15
– 20
– 10
0
– 170
– 64
– 60
—
—
—
ns
tsu(0)
5.0
10
15
– 20
– 10
0
– 91
– 58
– 48
—
—
—
ns
Data to Clock Hold Time
th(1)
5.0
10
15
350
165
155
263
109
100
—
—
—
ns
th(0)
5.0
10
15
350
200
140
267
140
93
—
—
—
ns
Clock Input Rise and Fall Times
tr, tf
5.0
10
15
—
—
—
—
—
—
15
5
4
μ
s
* The formulas given are for the typical characteristics only at 25 C.
#Data labelled “Typ” is not to be used for design purposes but is intended as an indication of the IC’s potential performance.
Figure 1. Power Dissipation Test Circuit and Waveforms
VDD
DATA
CLOCK
Q128
Q112
Q96
Q80
Q64
Q48
Q32
Q16
VSS
7
ID
500
μ
F
CL
CL
CL
CL
CL
CL
CL
CL
fo
CLOCK
DATA
(f = 1/2 fo)
VDD
VSS
VDD
VSS
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PDF描述
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