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參數(shù)資料
| 型號： | KS57C0502 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | MICROCONTROLLER |
| 中文描述： | 單片機(jī) |
| 文件頁數(shù)： | 221/282頁 |
| 文件大小： | 1966K |
| 代理商： | KS57C0502 |
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KS57C0502/C0504/P0504 MICROCONTROLLER
TIMERS and TIMER/COUNTER
11–7
WATCH-DOG TIMER MODE REGISTER (WDMOD)
The watch-dog timer mode register, WDMOD, is a 8-bit write-only register located at RAM address F98H -
F99H. WDMOD register controls to enable or disable the watch-dog timer function. WDMOD values are set to
logic "A5H" following
RESET
and this value enable the watch-dog timer, and watch-dog time
interval because
BT
overflow signal is
generated with the longest interval. (BT counter operation cannot be stopped.)
period is set to the longest
WDMOD - Watch–Dog Timer Mode Control Register
F99H,F98H
Bit
Identifier
3
.7
1
W
2
.6
0
W
1
.5
1
W
0
.4
0
W
3
.3
0
W
2
.2
1
W
1
.1
0
W
0
.0
1
W
RESET
Value
Read/Write
WDMOD
Watch-Dog Timer Enable/Disable Control
5AH
Disable Watch-dog timer function
Any other Value
Enable Watch-dog timer function
WATCH-DOG TIMER COUNTER (WDCNT)
WDCNT is an 3-bit counter. WDCNT is automatically cleared to logic zero whenever the WDTCF register
control bit (WDTCF) is set to "1" to restart the WDCNT. Reset, stop, and wait signal clear the WDCNT to logic
zero also. WDCNT is incremented each time a clock pulse of the overflow frequency determined by the current
BMOD bit settings. When WDCNT has incremented to hexadecimal '07H' (8 BT overflow pulses), it is cleared to
'00H' and an overflow is generated. The overflow causes the system reset. When the interrupt request is
generated, BCNT immediately resumes counting incoming clock signals.
WATCH-DOG TIMER'S COUNTER CLEAR FLAG(WDTCF)
WDTCF(F9AH.3) setting clear the WDT's counter to zero and restart the WDT's counter.
Table 11-3. Watch-Dog Timer Interval Time
BMOD
BT Input Clock
WDCNT input clock
WDT interval time
Main clock
x000b
2
12
/fx
2
12
/fx
×
2
8
2
12
/fx
×
2
8
×
2
3
2 sec
x011b
2
9
/fx
2
9
/fx
×
2
8
2
9
/fx
×
2
8
×
2
3
250 msec
x101b
2
7
/fx
2
7
/fx
×
2
8
2
7
/fx
×
2
8
×
2
3
62.5 msec
x111b
2
5
/fx
2
5
/fx
×
2
8
2
5
/fx
×
2
8
×
2
3
15.6 msec
NOTES
:
1.
2. fx = system clock frequency.
Clock frequencies assume a system oscillator clock frequency (fx) of : Main clock 4.19MHz
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