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參數(shù)資料
| 型號： | KS57C0502 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | MICROCONTROLLER |
| 中文描述： | 單片機 |
| 文件頁數(shù)： | 188/282頁 |
| 文件大?。?/td> | 1966K |
| 代理商： | KS57C0502 |
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INTERRUPTS
KS57C0502/C0504/P0504 MICROCONTROLLER
7–8
PROGRAMMING TIP — Setting the INT Interrupt Priority
Set the INT1 interrupt to high priority:
BITS
SMB
DI
LD
LD
EI
EMB
15
;
IPR.3 (IME)
←
0
A,#3H
IPR,A
;
IPR.3 (IME)
←
1
EXTERNAL INTERRUPT MODE REGISTERS (IMOD0, IMOD1)
The following components are used to process external interrupts at the INT0 and INT1 pin:
— Noise filtering circuit for INT0
— Edge detection circuit
— Two mode registers, IMOD0 and IMOD1
The mode registers are used to control the triggering edge of the input signal. IMOD settings let you choose
either the rising or falling edge of the incoming signal at the INT0 and INT1 pins as the interrupt request trigger.
FB4H
FB5H
IMOD0.3
"0"
"0"
"0"
IMOD0.1
"0"
IMOD0.0
IMOD1.0
IMOD0 and IMOD1 bits are mapped to RAM addresses FB4H (IMOD0) and FB5H (IMOD1), and are
addressable by 4-bit write instructions.
RESET
clears all IMOD values to logic zero, selecting rising edges as the
trigger for incoming interrupt requests.
Table 7–5. IMOD0 and IMOD1 Register Organization
IMOD0
IMOD0.3
0
1
0
IMOD0.1
IMOD0.0
Effect of IMOD0 Settings
Select CPU clock for sampling
Select fx/64 sampling clock
Rising edge detection
Falling edge detection
Both rising and falling edge detection
IRQ0 flag cannot be set to "1"
0
0
1
1
0
1
0
1
IMOD1
0
0
0
IMOD1.0
0
1
Effect of IMOD1 Settings
Rising edge detection
Falling edge detection
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