參數(shù)資料
型號(hào)： IWE8-CMAP-PXB4219
英文描述： Interworking Element
中文描述： 互通元素
文件頁數(shù)： 119/295頁
文件大小： 3790K
代理商： IWE8-CMAP-PXB4219
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PXB4219 / PXB4220 / PXB4221
Interface Description
Data Sheet
119
2000-09-04
5.6
External RAM Interface
The IWE8 needs to be connected to an external synchronous SRAM of 64k x 33 bits with
parity protection or 64k x 32 bits without parity protection.
For proper operation FT (Flow Through) SSRAM is needed. Pipelined SSRAM can not
be used, as this type has additional registered outputs.
A possible connection with 1 SRAM 64k x 36 component is shown in
Figure 34
.
.
Figure 34
External RAM Connection
The IWE8 has a fixed RAM interface cycle of 12 clock periods. A sequence of
6 consecutive read cycles (addresses AR1 to AR6), a dummy address cycle and
5 consecutive write cycles (addresses AW1 to AW5) is continuously repeated. The
timing of RMADC and RMOE is always fixed as shown in
Figure 35
. Whether the IWE8
reads data from the external RAM or writes data into the external RAM is controlled by
the RMCS and RMWR signals. In
Figure 35
, data R1 and R3 are actually read by the
IWE8, and data W1 and W3 are actually written into the external RAM.
Figure 35
RAM Interface Protocol
IWE8
RMDAT[0-32]
RMWR
RMOE
RMCS
RMADC
RMADR[0-15]
RMCLK
SRAM 64K x 36
D[0-35]
OE
ADSC
WR
CLK
A[0-15]
CS
R1
R2
R3
R4
R5
W1
W2
W3
W4
W5
R1
W5
R1
R2
R3
R4
R6
W5
W1
W2
W3
W4
W5
RAM cycle
RMADC
RMCLK
RMADR
RMOE
RMDAT
RMWR
RMCS
R6
R5
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PDF描述
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