參數(shù)資料
型號(hào)： HEF4517BP
廠商： NXP Semiconductors N.V.
元件分類(lèi)： 通用總線功能
英文描述： Dual 64-bit static shift register
封裝： HEF4517BP<SOT38-4 (DIP16)|<<http://www.nxp.com/packages/SOT38-4.html<1<Always Pb-free,;HEF4517BT<SOT162-1 (SO16)|<<http://www.nxp.com/packages/SOT162-1.html<1<Alway
文件頁(yè)數(shù)： 7/16頁(yè)
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代理商： HEF4517BP
HEF4517B
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NXP B.V. 2011. All rights reserved.
Product data sheet
Rev. 7 — 11 November 2011
7 of 16
NXP Semiconductors
HEF4517B
Dual 64-bit static shift register
10. Dynamic characteristics
[1]
The typical values of the propagation delay and transition times are calculated from the extrapolation formulas shown (C
L
in pF).
Table 7.
V
SS
= 0 V; T
amb
= 25
C; for test circuit see
Figure 8
; unless otherwise specified.
Symbol
Parameter
Conditions
t
PHL
HIGH to LOW
propagation delay
see
Figure 4
Dynamic characteristics
V
DD
5 V
10 V
15 V
5 V
10 V
15 V
5 V
10 V
15 V
5 V
10 V
15 V
5 V
10 V
15 V
5 V
Extrapolation formula
Min
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
Typ
220
85
60
190
75
50
40
30
25
45
25
20
50
30
25
60
Max
440
170
120
380
150
100
80
60
50
90
50
40
100
60
50
120
Unit
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
nCP to nQn;
[1]
193 ns + (0.55 ns/pF)C
L
74 ns + (0.23 ns/pF)C
L
52 ns + (0.16 ns/pF)C
L
[1]
163 ns + (0.55 ns/pF)C
L
64 ns + (0.23 ns/pF)C
L
42 ns + (0.16 ns/pF)C
L
t
PLH
LOW to HIGH
propagation delay
nCP to nQn;
see
Figure 4
t
PHZ
HIGH to OFF-state
propagation delay
nPE/OE to nQn;
see
Figure 5
t
PZH
OFF-state to HIGH
propagation delay
nPE/OE to nQn;
see
Figure 5
t
PLZ
LOW to OFF-state
propagation delay
nPE/OE to nQn;
see
Figure 5
t
PZL
OFF-state to LOW
propagation delay
nPE/OE to nQn;
see
Figure 5
10 V
15 V
5 V
10 V
15 V
5 V
10 V
15 V
5 V
10 V
15 V
5 V
10 V
15 V
5 V
10 V
15 V
-
-
-
-
-
30
25
20
45
30
25
-
-
-
2
6
8
30
25
60
30
20
10
5
5
15
10
10
95
40
30
5
12
16
60
50
120
60
40
-
-
-
-
-
-
190
80
60
-
-
-
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
MHz
MHz
MHz
t
t
transition time
nQn;
see
Figure 6
[1]
10 ns + (1.00 ns/pF)C
L
9 ns + (0.42 ns/pF)C
L
6 ns + (0.28 ns/pF)C
L
t
su
set-up time
nQn, nD to nCP;
see
Figure 7
t
h
hold time
nQn, nD to nCP;
see
Figure 7
t
W
pulse width
nQn, nD to nCP;
see
Figure 7
f
max
maximum
frequency
see
Figure 7
相關(guān)PDF資料
PDF描述
HEF4517BT Dual 64-bit static shift register
HEF4518BP Dual BCD counter
HEF4518BT Dual BCD counter
HEF4520BP Dual binary counter
HEF4520BT Dual binary counter
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參數(shù)描述
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