參數(shù)資料
型號： HEF4075BT
廠商： NXP Semiconductors N.V.
元件分類： 通用總線功能
英文描述： Triple 3-input OR gate
封裝： HEF4075BP<SOT27-1 (DIP14)|<<http://www.nxp.com/packages/SOT27-1.html<1<Always Pb-free,;HEF4075BT<SOT108-1 (SO14)|<<http://www.nxp.com/packages/SOT108-1.html<1<week
文件頁數(shù)： 3/3頁
文件大小： 25K
代理商： HEF4075BT
January 1995
3
Philips Semiconductors
Product specification
Triple 3-input OR gate
HEF4075B
gates
AC CHARACTERISTICS
V
SS
= 0 V; T
amb
= 25
°
C; C
L
= 50 pF; input transition times
≤
20 ns
V
DD
V
SYMBOL
TYP.
MAX.
TYPICAL EXTRAPOLATION
FORMULA
Propagation delays
I
n
→
O
n
HIGH to LOW
5
65
30
20
65
30
25
60
30
20
60
30
20
130
60
40
130
60
50
120
60
40
120
60
40
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
38 ns
19 ns
12 ns
38 ns
19 ns
17 ns
10 ns
9 ns
6 ns
10 ns
9 ns
6 ns
+
+
+
+
+
+
+
+
+
+
+
+
(0,55 ns/pF) C
L
(0,23 ns/pF) C
L
(0,16 ns/pF) C
L
(0,55 ns/pF) C
L
(0,23 ns/pF) C
L
(0,16 ns/pF) C
L
(1,0 ns/pF) C
L
(0,42 ns/pF) C
L
(0,28 ns/pF) C
L
(1,0 ns/pF) C
L
(0,42 ns/pF) C
L
(0,28 ns/pF) C
L
10
15
5
10
15
t
PHL
LOW to HIGH
t
PLH
Output transition times
HIGH to LOW
5
10
15
5
10
15
t
THL
LOW to HIGH
t
TLH
V
DD
V
TYPICAL FORMULA FOR P (
μ
W)
Dynamic power
dissipation per
package (P)
5
750 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
3 600 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
11 200 f
i
+ ∑
(f
o
C
L
)
×
V
DD2
where
f
i
= input freq. (MHz)
f
o
= output freq. (MHz)
C
L
= load capacitance (pF)
∑
(f
o
C
L
) = sum of outputs
V
DD
= supply voltage (V)
10
15
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PDF描述
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HEF4076B 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Quadruple D-type register with 3-state outputs
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