參數資料
| 型號： | EPM7512AEFC256-7 |
| 廠商： | Altera |
| 文件頁數： | 26/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAX 7000 CPLD 512 256-FBGA |
| 標準包裝： | 90 |
| 系列： | MAX® 7000A |
| 可編程類型： | 系統(tǒng)內可編程 |
| 最大延遲時間 tpd(1)： | 7.5ns |
| 電壓電源 - 內部： | 3 V ~ 3.6 V |
| 邏輯元件/邏輯塊數目： | 32 |
| 宏單元數： | 512 |
| 門數： | 10000 |
| 輸入/輸出數： | 212 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BGA |
| 供應商設備封裝： | 256-FBGA（17x17） |
| 包裝： | 托盤 |
| 其它名稱： | 544-2357 |
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Altera Corporation
MAX 7000A Programmable Logic Device Data Sheet
Figure 11. MAX 7000A Timing Model
The timing characteristics of any signal path can be derived from the
timing model and parameters of a particular device. External timing
parameters, which represent pin-to-pin timing delays, can be calculated
as the sum of internal parameters. Figure 12 shows the timing relationship
between internal and external delay parameters.
information.
Logic Array
Delay
t LAD
Output
Delay
t OD3
t OD2
t OD1
t XZ
Z
t X1
t ZX2
t ZX3
Input
Delay
t IN
Register
Delay
t SU
t H
t PRE
t CLR
t RD
t COMB
t FSU
t FH
PIA
Delay
t PIA
Shared
Expander Delay
t SEXP
Register
Control Delay
t LAC
t IC
t EN
I/O
Delay
t IO
Global Control
Delay
t GLOB
Internal Output
Enable Delay
t IOE
Parallel
Expander Delay
t PEXP
Fast
Input Delay
t FIN
相關PDF資料 |
PDF描述 |
|---|---|
| EPM7512BFC256-5 | IC MAX 7000 CPLD 512 256-FBGA |
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| ET80960JT10016 | IC MPU I960JT 3V 100MHZ 132-QFP |
| EX256-PTQG100I | IC FPGA ANTIFUSE 12K 100-TQFP |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| EPM7512AEFI25610 | 制造商:ALTERA 功能描述:NEW |
| EPM7512AEFI256-10 | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 512 Macro 212 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7512AEFI256-10N | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 512 Macro 212 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7512AEQC20810 | 制造商:ALTERA 功能描述:* |
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