參數(shù)資料
型號： EP20K100RC240-1
英文描述： 8-Bit Video Analog Front End (AFE) with Measurement and Auto-Adjust Features; Temperature Range: 0&degC to 70°C; Package: 80-EPTQFP
中文描述： 現(xiàn)場可編程門陣列（FPGA）
文件頁數(shù)： 64/114頁
文件大?。?/td> 1623K
代理商： EP20K100RC240-1
Altera Corporation
53
APEX 20K Programmable Logic Device Family Data Sheet
Tables 17 and 18 summarize the ClockLock and ClockBoost parameters
for APEX 20KE devices.
Table 17. APEX 20KE ClockLock & ClockBoost Parameters
Symbol
Parameter
Condition
Min
Typ
Max
Unit
tR
Input rise time
5ns
tF
Input fall time
5ns
tINDUTY
Input duty cycle
40
60
%
tINJITTER
Input jitter peak-to-peak
2
% of input
period
peak-to-
peak
tOUTJITTER Jitter on ClockLock or ClockBoost-
generated clock
0.35
% of
output period
RMS
tOUTDUTY
Duty cycle for ClockLock or
ClockBoost-generated clock
45
55
%
tLOCK (2),
Time required for ClockLock or
ClockBoost to acquire lock
40
s
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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EP20K100RC240-2ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA
EP20K100RC240-3 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA)
EP20K100RC240-3ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA
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