參數(shù)資料
型號(hào)： EP1C6T256I8ES
廠商： Altera Corporation
英文描述： Cyclone FPGA Family Data Sheet
中文描述： 氣旋的FPGA系列數(shù)據(jù)手冊(cè)
文件頁數(shù)： 32/104頁
文件大?。?/td> 763K
代理商： EP1C6T256I8ES
2–26
Preliminary
Altera Corporation
January 2007
Cyclone Device Handbook, Volume 1
Figure 2–18. Input/Output Clock Mode in True Dual-Port Mode
Note (1)
,
(2)
Notes to
Figure 2–18
:
(1)
All registers shown have asynchronous clear ports.
(2)
Violating the setup or hold time on the address registers could corrupt the memory contents. This applies to both
read and write operations.
6
D
ENA
Q
D
ENA
Q
D
ENA
Q
data
A
[ ]
address
A
[ ]
Memory Block
512
×
8
1,024
×
4
2,04
8
×
2
4,096
×
1
Data In
Address A
Write/Read
Ena
b
le
Data O
u
t
Data In
Address B
Write/Read
Ena
b
le
Data O
u
t
clken
A
clock
A
D
ENA
Q
w
ren
A
6 LAB Ro
w
Clocks
q
A
[ ]
6
data
B
[ ]
address
B
[ ]
clken
B
clock
B
w
ren
B
q
B
[ ]
ENA
A
B
ENA
D
Q
ENA
D
Q
ENA
D
Q
D
Q
D
ENA
Q
b
yteena
A
[ ]
Byte Ena
b
le A
Byte Ena
b
le B
b
yteena
B
[ ]
ENA
D
Q
Write
P
u
lse
Generator
Write
P
u
lse
Generator
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PDF描述
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