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參數(shù)資料
| 型號(hào)： | EDD5104ADTA-6BL |
| 廠商： | ELPIDA MEMORY INC |
| 元件分類： | DRAM |
| 英文描述： | 512M bits DDR SDRAM |
| 中文描述： | 128M X 4 DDR DRAM, 0.7 ns, PDSO66 |
| 封裝： | PLASTIC, TSOP2-66 |
| 文件頁(yè)數(shù)： | 39/49頁(yè) |
| 文件大?。?/td> | 568K |
| 代理商： | EDD5104ADTA-6BL |
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EDD5104ADTA-E, EDD5108ADTA-E, EDD5116ADTA-E
Preliminary Data Sheet E0501E10 (Ver. 1.0)
39
DM Control
DM can mask input data. In
×
16 products, UDM and LDM can mask the upper and lower byte of input data
respectively. By setting DM to Low, data can be written. When DM is set to High, the corresponding data is not
written, and the previous data is held. The latency between DM input and enabling/disabling mask function is 0.
Mask
Mask
DQS
DQ
DM
t1
t2
t3
t4
t5
t6
Write mask latency = 0
DM Control
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EDD5108ADTA-5C | 512M bits DDR SDRAM |
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| EDD5108AFTA-5 | 512M bits DDR SDRAM |
| EDD5108ADTA-6BL-E | 512M bits DDR SDRAM |
| EDD5108ADTA-7BL-E | 512M bits DDR SDRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EDD5104ADTA-7AL-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
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