參數(shù)資料
型號： CY7C1307BV25-167BZC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類： DRAM
英文描述： 18-Mbit Burst of 4 Pipelined SRAM with QDR Architecture
中文描述： 512K X 36 QDR SRAM, 2.5 ns, PBGA165
封裝： 13 X 15 MM, 1.40 MM HEIGHT, MO-216, FBGA-165
文件頁數(shù)： 15/21頁
文件大?。?/td> 247K
代理商： CY7C1307BV25-167BZC
PRELIMINARY
CY7C1305BV25
CY7C1307BV25
Document #: 38-05630 Rev. **
Page 15 of 21
TAP Controller State Diagram
[26]
Note:
26.The 0/1 next to each state represents the value at TMS at the rising edge of TCK.
TEST-LOGIC
RESET
0
TEST-LOGIC/
IDLE
SELECT
DR-SCAN
CAPTURE-DR
SHIFT-DR
EXIT1-DR
PAUSE-DR
EXIT2-DR
UPDATE-DR
SELECT
IR-SCAN
CAPTURE-IR
SHIFT-IR
EXIT1-IR
PAUSE-IR
EXIT2-IR
UPDATE-IR
1
0
1
1
0
1
0
1
0
0
0
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0
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PDF描述
CY7C1305BV25-133BZC 18-Mbit Burst of 4 Pipelined SRAM with QDR Architecture
CY7C1305BV25-167BZC 18-Mbit Burst of 4 Pipelined SRAM with QDR Architecture
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CY7C1303BV25 18-Mbit Burst of 2 Pipelined SRAM with QDR Architecture(18Mbit，Burst of 2，QDR結(jié)構(gòu)，流水線SRAM)
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參數(shù)描述
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