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參數(shù)資料
| 型號(hào)： | CY7C1304V25 |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | 9-Mb Pipelined SRAM with QDR Architecture(帶QDR結(jié)構(gòu)的9-M位流水線式 SRAM) |
| 中文描述： | 9 - MB的流水線架構(gòu)的SRAM與國防評(píng)估報(bào)告（帶國防評(píng)估報(bào)告結(jié)構(gòu)的9米位流水線式的SRAM） |
| 文件頁數(shù)： | 11/23頁 |
| 文件大?。?/td> | 216K |
| 代理商： | CY7C1304V25 |
CY7C1304V25
Advanced Information
11
TAP Controller State Diagram
TEST-LOGIC
RESET
0
TEST-LOGIC/
IDLE
SELECT
DR-SCAN
CAPTURE-DR
SHIFT-DR
EXIT1-DR
PAUSE-DR
EXIT2-DR
UPDATE-DR
SELECT
IR-SCAN
CAPTURE-IR
SHIFT-IR
EXIT1-IR
PAUSE-IR
EXIT2-IR
UPDATE-IR
1
0
1
1
0
1
0
1
0
0
0
1
1
1
0
1
0
1
0
0
0
1
0
1
1
0
1
0
0
1
1
Note: The 0/1 next to each state represents the value at TMS at the rising edge of TCK.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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