參數(shù)資料
型號： COP8SGH040V7
廠商： National Semiconductor Corporation
元件分類： 基準電壓源/電流源
英文描述： LP3852/LP3855 1.5A Fast Response Ultra Low Dropout Linear Regulators; Package: SOT-223; No of Pins: 5
中文描述： 8位的CMOS基于ROM和OTP微控制器具有8K到32K的內存，2個比較器和USART
文件頁數(shù)： 17/62頁
文件大小： 913K
代理商： COP8SGH040V7
6.0 Timers (Continued)
6.3 TIMER CONTROL FLAGS
The control bits and their functions are summarized below.
TxC3
Timer mode control
TxC2
Timer mode control
TxC1
Timer mode control
TxC0
Timer Start/Stop control in Modes 1 and 2 (Pro-
cessor Independent PWM and External Event
Counter), where 1 = Start, 0 = Stop
Timer Underflow Interrupt Pending Flag in Mode
3 (Input Capture)
TxPNDA Timer Interrupt Pending Flag
TxENA
Timer Interrupt Enable Flag
1 = Timer Interrupt Enabled
0 = Timer Interrupt Disabled
TxPNDB Timer Interrupt Pending Flag
TxENB
Timer Interrupt Enable Flag
1 = Timer Interrupt Enabled
0 = Timer Interrupt Disabled
The timer mode control bits (TxC3, TxC2 and TxC1) are
detailed below:
Mode
TxC3
TxC2
TxC1
Description
Interrupt A
Source
Interrupt B
Source
Timer
Counts On
1
0
1
PWM: TxA Toggle
Autoreload RA
Autoreload RB
t
C
1
0
PWM: No TxA
Toggle
Autoreload RA
Autoreload RB
t
C
2
0
External Event
Counter
Timer Underflow
Pos. TxB Edge
Pos. TxA
Edge
0
1
External Event
Counter
Timer Underflow
Pos. TxB Edge
Pos. TxA
Edge
3
0
1
0
Captures:
Pos. TxA Edge
Pos. TxB Edge
t
C
TxA Pos. Edge
or Timer
TxB Pos. Edge
Underflow
1
0
Captures:
Pos. TxA
Neg. TxB
t
C
TxA Pos. Edge
Edge or Timer
Edge
TxB Neg. Edge
Underflow
0
1
Captures:
Neg. TxA
Neg. TxB
t
C
TxA Neg. Edge
Edge or Timer
Edge
TxB Neg. Edge
Underflow
1
Captures:
Neg. TxA
Neg. TxB
t
C
TxA Neg. Edge
Edge or Timer
Edge
TxB Neg. Edge
Underflow
COP8SG
Family
www.national.com
24
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PDF描述
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COP8SGH044D7 LP38691/LP38693 500mA Low Dropout CMOS Linear Regulators Stable with Ceramic Output Capacitors; Package: LLP; No of Pins: 6
COP8SGH044D8 LP38691/LP38693 500mA Low Dropout CMOS Linear Regulators Stable with Ceramic Output Capacitors; Package: LLP; No of Pins: 6
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